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Vivado 用户约束sdc文件常用命令.doc

上传人:精品资料 文档编号:9387898 上传时间:2019-08-05 格式:DOC 页数:1 大小:15.30KB
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Vivado 用户约束sdc文件常用命令.doc_第1页
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1、Vivado 用户约束 sdc文件常用命令1.外部时钟输入的约束如下:create_clock -period (clock period) -name (clock name) -waveform (Traise), (Tfall) get_ports (clock port name)2.已建立的时钟改名create_generated_clock -name (clock name) get_pins (path)3.input/output delay设置set_input_delay -clock get_clocks (clock name) (delay time ns) all

2、 inputsset_output_delay -clock get_clocks (clock name) (delay time ns) all outputs4.建立时钟组set_clock_groups -name (group name) -asynchronous -group (clock name) (clock name) set_clock_groups -name (group name) -asynchronous -group get_clocks (clock name)5.管脚分配set_property PACKAGE_PIN (pin location) ge

3、t_ports (port name)set_property IOSTANDARD (level:LVDS,LVCMOS18,LVCMOS33 etc.) get_ports (port name)6.管脚作为时钟线set_property CLOCK_DEDICATED_ROUTE FALSE get_nets (port_name)7.管脚拉高set_property PULLUP true get_ports (port name)8.当 vivado报错说有某些管脚没有分配时,加下面两句set_property SEVERITY Warning get_drc_checks NSTD-1set_property SEVERITY Warning get_drc_checks UCIO-1

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