1、仪器科学与技术专业毕业论文 精品论文 基于 SDH 帧数据的ATM 信元提取与解析技术研究关键词：同步数字体系 异步传输模式 信元提取算法 解析技术 现场可编程门阵列摘要：论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据ATMOverSDH 的相关理论研究与工程实践，提出了“利用信头差错控制(即HEC，
2、Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行 CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“A
3、ND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM业务信息提供了一个新的解决方案。正文内容论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元
4、提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据ATMOverSDH 的相关理论研究与工程实践，提出了“利用信头差错控制(即HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Arra
5、y)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行 CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierar
6、chy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的
7、识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取
8、与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对
9、该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。
10、(4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)
11、根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行C
12、RC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer
13、Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场
14、可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方
15、案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主
16、要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以
17、看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 H
18、EC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和
19、“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元
20、提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Arr
21、ay)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hier
22、archy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配
23、层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元
24、提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。论文以同步数字体系(即 SDH，Synchronous Digital Hierarchy)网中的异步传输模式(即 ATM，Asynchronous Transfer Mode)信元为主要的研究对象，并采用了两种实现方式对 SDH 网中的 ATM 信元提取与解析系统进行具体实现，对两种实现方式进行了比较分析研究。文章的主要内容是： (1)根据 ATMOverSDH的相关理论研究与工程实践，提出了“利用信头差错控制(即 HEC，Header Error Control)的 ATM 信元提取算法” ，从理论
25、上对该算法进行深入研究，并通过仿真实验，验证了该算法性能。 (2)以 ATM 信元作为主要研究对象，从理论角度对 ATM 信元进行具体解析，包括 ATM 空闲信元和各个适配层的识别与提取以及各个适配层承载用户信息的重组与提取。 (3)构建两种实现方式：基于现场可编程序门阵列(即 FPGA，Filed Programmable Gate Array)和基于服务器来实现 SDH 中的 ATM 信元的提取与解析。前者，重点分析了并行CRC(Cyclic Redundancy Check)算法，并利用“XOR 平面”和“AND 平面”来实现 CRC 中的单比特纠错。后者，主要从软件角度分层实现各个功能
26、。 (4)从实验角度实现两种方式，并对实验结果进行分析。 由本文的理论分析和实验结果可以看出，本文分析方法和结论都是正确的。所提出的方法使得 SDH 网络中的 ATM 信元提取与解析成为可能，并为解决实时检测 SDH 中的 ATM 业务信息提供了一个新的解决方案。特别提醒 ：正文内容由 PDF 文件转码生成，如您电脑未有相应转换码，则无法显示正文内容，请您下载相应软件，下载地址为 http:/ 。如还不能显示，可以联系我 q q 1627550258 ，提供原格式文档。“垐垯櫃 换烫梯葺铑?endstreamendobj2x 滌?U 閩 AZ箾 FTP 鈦X 飼?狛P? 燚?琯嫼 b?袍*甒?
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