1、51单片机 I/O 口工作原理一、P0 端口的结构及工作原理P0端口 8位中的一位结构图见下图：由上图可见，P0端口由锁存器、输入缓冲器、切换开关、一个与非门、一个与门及场效应管驱动电路构成。再看图的右边，标号为 P0.X 引脚的图标，也就是说 P0.X 引脚可以是 P0.0到 P0.7的任何一位，即在 P0口有8个与上图相同的电路组成。下面，我们先就组成 P0口的每个单元部份跟大家介绍一下：先看输入缓冲器：在 P0口中，有两个三态的缓冲器，在学数字电路时，我们已知道，三态门有三个状态，即在其的输出端可以是高电平、低电平，同时还有一种就是高阻状态（或称为禁止状态） ，大家看上图，上面一个是读锁
2、存器的缓冲器，也就是说，要读取 D 锁存器输出端 Q 的数据，那就得使读锁存器的这个缓冲器的三态控制端（上图中标号为读锁存器 端）有效。下面一个是读引脚的缓冲器，要读取 P0.X 引脚上的数据，也要使标号为读引脚 的这个三态缓冲器的控制端有效，引脚上的数据才会传输到我们单片机的内部数据总线上。D 锁存器：构成一个锁存器，通常要用一个时序电路，时序的单元电路在学数字电路时我们已知道，一个触发器可以保存一位的二进制数（即具有保持功能） ，在51单片机的32 根 I/O 口线中都是用一个 D 触发器来构成锁存器的。大家看上图中的 D 锁存器，D 端是数据输入端， CP 是控制端（也就是时序控制信号输
3、入端） ，Q 是输出端，Q 非是反向输出端。对于 D 触发器来讲，当 D 输入端有一个输入信号，如果这时控制端 CP 没有信号（也就是时序脉冲没有到来） ，这时输入端 D 的数据是无法传输到输出端 Q 及反向输出端 Q 非的。如果时序控制端 CP 的时序脉冲一旦到了，这时 D 端输入的数据就会传输到 Q 及 Q 非端。数据传送过来后，当 CP 时序控制端的时序信号消失了，这时，输出端还会保持着上次输入端 D 的数据（即把上次的数据锁存起来了） 。如果下一个时序控制脉冲信号来了，这时 D 端的数据才再次传送到 Q 端，从而改变 Q 端的状态。多路开关：在51单片机中，当内部的存储器够用（也就是不
4、需要外扩展存储器时，这里讲的存储器包括数据存储器及程序存储器）时，P0口可以作为通用的输入输出端口（即 I/O）使用，对于8031（内部没有 ROM）的单片机或者编写的程序超过了单片机内部的存储器容量，需要外扩存储器时，P0口就作为地址/数据 总线使用。那么这个多路选择开关就是用于选择是做为普通 I/O 口使用还是作为数据/地址总线使用的选择开关了。大家看上图，当多路开关与下面接通时，P0口是作为普通的 I/O 口使用的，当多路开关是与上面接通时，P0口是作为地址/数据总线使用的。输出驱动部份：从上图中我们已看出，P0口的输出是由两个 MOS 管组成的推拉式结构，也就是说，这两个 MOS 管一
5、次只能导通一个，当 V1导通时，V2就截止，当 V2导通时，V1截止。与门、与非门：这两个单元电路的逻辑原理我们在第四课数字及常用逻辑电路时已做过介绍，不明白的同学请回到第四节去看看。前面我们已将 P0口的各单元部件进行了一个详细的讲解，下面我们就来研究一下 P0口做为 I/O 口及地址/数据总线使用时的具体工作过程。1、作为 I/O 端口使用时的工作原理P0口作为 I/O 端口使用时，多路开关的控制信号为0（低电平） ，看上图中的线线部份，多路开关的控制信号同时与与门的一个输入端是相接的，我们知道与门的逻辑特点是“全1出1，有0出0”那么控制信号是0的话，这时与门输出的也是一个0（低电平）
6、，与让的输出是0，V1 管就截止，在多路控制开关的控制信号是0（低电平）时，多路开关是与锁存器的 Q 非端相接的（即 P0口作为 I/O 口线使用） 。P0口用作 I/O 口线，其由数据总线向引脚输出（即输出状态 Output）的工作过程：当写锁存器信号 CP 有效，数据总线的信号锁存器的输入端 D锁存器的反向输出 Q 非端多路开关V2管的栅极V2 的漏极到输出端 P0.X。前面我们已讲了，当多路开关的控制信号为低电平0时，与门输出为低电平，V1管是截止的，所以作为输出口时，P0是漏极开路输出，类似于 OC 门，当驱动上接电流负载时，需要外接上拉电阻。下图就是由内部数据总线向 P0口输出数据的
7、流程图（红色箭头） 。P0口用作 I/O 口线，其由引脚向内部数据总线输入（即输入状态 Input）的工作过程：数据输入时（读 P0口）有两种情况1、读引脚读芯片引脚上的数据，读引脚数时，读引脚缓冲器打开（即三态缓冲器的控制端要有效） ，通过内部数据总线输入，请看下图（红色简头） 。2、读锁存器通过打开读锁存器三态缓冲器读取锁存器输出端 Q 的状态，请看下图（红色箭头）：在输入状态下，从锁存器和从引脚上读来的信号一般是一致的，但也有例外。例如，当从内部总线输出低电平后，锁存器 Q0，Q 非1 ，场效应管 T2开通，端口线呈低电平状态。此时无论端口线上外接的信号是低电乎还是高电平，从引脚读入单片
8、机的信号都是低电平，因而不能正确地读入端口引脚上的信号。又如，当从内部总线输出高电平后，锁存器 Q1 ，Q 非0，场效应管 T2截止。如外接引脚信号为低电平，从引脚上读入的信号就与从锁存器读入的信号不同。为此，8031单片机在对端口 P0一 P3的输入操作上，有如下约定：为此，8051单片机在对端口 P0一 P3的输入操作上，有如下约定：凡属于读-修改-写方式的指令，从锁存器读入信号，其它指令则从端口引脚线上读入信号。读-修改- 写指令的特点是，从端口输入(读) 信号，在单片机内加以运算( 修改)后，再输出(写)到该端口上。下面是几条读-修改-写指令的例子。这样安排的原因在于读-修改- 写指令
9、需要得到端口原输出的状态，修改后再输出，读锁存器而不是读引脚，可以避免因外部电路的原因而使原端口的状态被读错。P0端口是8031 单片机的总线口，分时出现数据 D7一 D0、低8位地址 A7一 AO，以及三态，用来接口存储器、外部电路与外部设备。P0端口是使用最广泛的 IO 端口。个人总结： P0口作输出时是开漏 OD 输出，故需要外接上拉电阻； 同一个端口可以分时做输入和输出用。2、作为地址/数据复用口使用时的工作原理在访问外部存储器时 P0口作为地址/ 数据复用口使用。这时多路开关控制信号为1 ， 与门 解锁， 与门输出信号电平由 “地址/数据”线信号决定；多路开关与反相器的输出端相连，地
10、址信号经“地址/ 数据”线反相器V2场效应管栅极V2 漏极输出。例如：控制信号为1，地址信号为“0”时，与门输出低电平，V1管截止；反相器输出高电平，V2 管导通，输出引脚的地址信号为低电平。请看下图（兰色字体为电平）：反之，控制信号为“1”、地址信号为“1”， “与门”输出为高电平，V1管导通；反相器输出低电平，V2管截止，输出引脚的地址信号为高电平。请看下图（兰色字体为电平）：可见，在输出“地址/数据”信息时，V1、V2管是交替导通的，负载能力很强，可以直接与外设存储器相连，无须增加总线驱动器。P0口又作为数据总线使用。在访问外部程序存储器时，P0 口输出低8位地址信息后，将变为数据总线，
11、以便读指令码（输入） 。在取指令期间， “控制” 信号为“ 0”，V1管截止，多路开关也跟着转向锁存器反相输出端 Q 非；CPU自动将0FFH（11111111 ，即向 D 锁存器写入一个高电平1）写入 P0口锁存器，使 V2管截止，在读引脚信号控制下，通过读引脚三态门电路将指令码读到内部总线。请看下图如果该指令是输出数据，如 MOVX DPTR，A（将累加器的内容通过 P0口数据总线传送到外部 RAM 中） ，则多路开关“控制”信号为1 ， “与门”解锁，与输出地址信号的工作流程类似，数据据由“地址/数据”线反相器 V2 场效应管栅极V2漏极输出。如果该指令是输入数据（读外部数据存储器或程序
12、存储器） ，如 MOVX A，DPTR（将外部 RAM某一存储单元内容通过 P0口数据总线输入到累加器 A 中） ，则输入的数据仍通过读引脚三态缓冲器到内部总线，其过程类似于上图中的读取指令码流程图。通过以上的分析可以看出，当 P0作为地址/ 数据总线使用时，在读指令码或输入数据前，CPU 自动向 P0口锁存器写入0FFH，破坏了 P0口原来的状态。因此，不能再作为通用的 I/O 端口。大家以后在系统设计时务必注意，即程序中不能再含有以 P0口作为操作数（包含源操作数和目的操作数）的指令。二、P1 端口的结构及工作原理P1口的结构最简单，用途也单一，仅作为数据输入/ 输出端口使用。输出的信息有
13、锁存，输入有读引脚和读锁存器之分。P1端口的一位结构见下图.由图可见，P1端口与 P0端口的主要差别在于，P1端口用内部上拉电阻 R 代替了 P0端口的场效应管 T1，并且输出的信息仅来自内部总线。由内部总线输出的数据经锁存器反相和场效应管反相后，锁存在端口线上，所以，P1端口是具有输出锁存的静态口。由上图可见，要正确地从引脚上读入外部信息，必须先使场效应管关断，以便由外部输入的信息确定引脚的状态。为此，在作引脚读入前，必须先对该端口写入 l。具有这种操作特点的输入/输出端口，称为准双向 I/O 口。8051单片机的 P1、P2、P3都是准双向口。P0端口由于输出有三态功能，输入前，端口线已处
14、于高阻态，无需先写入 l 后再作读操作。P1口的结构相对简单，前面我们已详细的分析了 P0口，只要大家认真的分析了 P0口的工作原理，P1口我想大家都有能力去分析，这里我就不多论述了。单片机复位后，各个端口已自动地被写入了1，此时，可直接作输入操作。如果在应用端口的过程中，已向 P1一 P3端口线输出过0，则再要输入时，必须先写1后再读引脚，才能得到正确的信息。此外，随输入指令的不同，H 端口也有读锁存器与读引脚之分。三、P2 端口的结构及工作原理:P2端口的一位结构见下图：由图可见，P2端口在片内既有上拉电阻，又有切换开关 MUX，所以 P2端口在功能上兼有 P0端口和 P1端口的特点。这主
15、要表现在输出功能上，当切换开关向下接通时，从内部总线输出的一位数据经反相器和场效应管反相后，输出在端口引脚线上；当多路开关向上时，输出的一位地址信号也经反相器和场效应管反相后，输出在端口引脚线上。对于8031单片机必须外接程序存储器才能构成应用电路（或者我们的应用电路扩展了外部存储器） ，而P2端口就是用来周期性地输出从外存中取指令的地址(高8位地址)，因此，P2端口的多路开关总是在进行切换，分时地输出从内部总线来的数据和从地址信号线上来的地址。因此 P2端口是动态的 I/O 端口。输出数据虽被锁存，但不是稳定地出现在端口线上。其实，这里输出的数据往往也是一种地址，只不过是外部 RAM 的高8
16、 位地址。在输入功能方面，P2端口与 P0和 H 端口相同，有读引脚和读锁存器之分，并且 P2端口也是准双向口。可见，P2 端口的主要特点包括：不能输出静态的数据；自身输出外部程序存储器的高8 位地址；执行 MOVX 指令时，还输出外部 RAM 的高位地址，故称 P2端口为动态地址端口。即然 P2口可以作为 I/O 口使用，也可以作为地址总线使用，下面我们就不分析下它的两种工作状态。1、作为 I/O 端口使用时的工作过程当没有外部程序存储器或虽然有外部数据存储器，但容易不大于256B，即不需要高8位地址时（在这种情况下，不能通过数据地址寄存器 DPTR 读写外部数据存储器） ，P2口可以 I/
17、O 口使用。这时， “控制”信号为“0”，多路开关转向锁存器同相输出端 Q，输出信号经内部总线锁存器同相输出端 Q反相器V2管栅极 V2 管9漏极输出。由于 V2漏极带有上拉电阻，可以提供一定的上拉电流，负载能力约为8 个 TTL 与非门；作为输出口前，同样需要向锁存器写入“1”，使反相器输出低电平，V2管截止，即引脚悬空时为高电平，防止引脚被钳位在低电平。读引脚有效后，输入信息经读引脚三态门电路到内部数据总线。2、作为地址总线使用时的工作过程P2口作为地址总线时， “控制 ”信号为 1，多路开关车向地址线（即向上接通） ，地址信息经反相器V2管栅极 漏极输出。由于 P2口输出高8位地址，与
18、P0口不同，无须分时使用，因此 P2口上的地址信息（程序存储器上的 A15A8）功数据地址寄存器高8位 DPH 保存时间长，无须锁存。四、P3 端口的结构及工作原理P3口是一个多功能口，它除了可以作为 I/O 口外，还具有第二功能，P3端口的一位结构见下图。由上图可见，P3端口和 Pl 端口的结构相似，区别仅在于 P3端口的各端口线有两种功能选择。当处于第一功能时，第二输出功能线为1，此时，内部总线信号经锁存器和场效应管输入/输出，其作用与 P1端口作用相同，也是静态准双向 I/O 端口。当处于第二功能时，锁存器输出1，通过第二输出功能线输出特定的内含信号，在输入方面，即可以通过缓冲器读入引脚
19、信号，还可以通过替代输入功能读入片内的特定第二功能信号。由于输出信号锁存并且有双重功能，故 P3端口为静态双功能端口。P3口的特殊功能（即第二功能）：使 P3端品各线处于第二功能的条件是:1、串行 I/O 处于运行状态 (RXD,TXD);2、打开了处部中断(INT0,INT1);3、定时器/计数器处于外部计数状态(T0,T1)4、执行读写外部 RAM 的指令(RD,WR)在应用中,如不设定 P3端口各位的第二功能(WR,RD 信叼的产生不用设置),则 P3端口线自动处于第一功能状态，也就是静态 I O 端口的工作状态。在更多的场合是根据应用的需要，把几条端口线设置为第二功能，而另外几条端口线处于第一功能运行状态。在这种情况下，不宜对 P3端口作字节操作，需采用位操作的形式。端口的负载能力和输入输出操作:P0端口能驱动8个 LSTTL 负载。如需增加负载能力，可在 P0总线上增加总线驱动器。P1，P2，P3端口各能驱动4个 LSTTL 负载。前已述及，由于 P0-P3端口已映射成特殊功能寄存器中的 P0一 P3端口寄存器，所以对这些端口寄存器的读写就实现了信息从相应端口的输入输出。例如：MOV A， P1 ；把 Pl 端口线上的信息输入到 AMoV P1， A ；把 A 的内容由 P1端口输出MOV P3， #0FFH ；使 P3端口线各位置 l
