1、实 验 报 告课程名称：电路与电子技术实验 指导老师：_成绩：_实验名称：时序逻辑电路设计& 脉冲分配 实验类型：_同组学生姓名：_一、实验目的和要求（必填） 二、实验内容和原理（必填）三、主要仪器设备（必填） 四、操作方法和实验步骤五、实验数据记录和处理 六、实验结果与分析（必填）七、讨论、心得一、 实验原理1、用 74LS107 型 JK 触发器和 74LS11 三输入与门设计 一个 8421BCD 码的同步十进制加法计数器。画出状态转换图列出状态表，得出对 JK 的要求求 JK 的函数式：（用卡诺图求，1010 至 1111 六种当无关项处理）专业：_姓名：_学号：_日期：_地点：_实验
2、驱动方程，按表达式画出电路图；连接电路：按照得到的各个输入函数的驱动方程来连接电路，4 个 JK 触发器的输出 Q 分别连数码管模块的 D、C、B、A（D 为高位） 。2、用 74LS74 型 D 触发器和 74LS55 与或非门设计脉冲分配器电路。脉冲分配器的作用是产生多路序列脉冲。设计过程：画出状态转换图列出状态表利用卡诺图，求 D 的函数式自启动的实现：利用触发器的异步复位和置位端，即当出现 000 和 111 状态时，将 QA、QB、QC置成有效状态（如 100，101） 。根据的表达式画出电路图，搭建电路。二、 实验数据记录1、同步十进制加法计数器，加入 1024Hz 的方波作为计数
3、脉冲，用示波器观察得到 CP 及 4 个输出端的波形，如下图所示。CPQ0Q0Q1Q1Q2Q3Q22、脉冲分配器，加入 1024Hz 的方波作为计数脉冲，用示波器观察记录 CP、QA、QB、QC 的波形，如下图所示。当 X=0 时CPQAQAQBQBQC当 X=1 时CPQAQAQBQBQC三、 实验结果与分析1、 通过示波器得到的波形正确性确认本次实验通过示波器得到了大量的波形，如何确认所得到的波形的正确性是我们应该学习的。将得到的波形与实验设计过程中的各个输出变量的真值表进行比较，即可确认。同步十进制加法计数器：波形与真值表相对照，Q0 在 CP 脉冲来的时候 0 和 1 交替出现，Q1
4、的序列则是 0011001100，Q2 的序列是 0000111100，Q3 的序列是 00000011，比对“实验数据记录”中得到的波形的高低电平出现的序列，可以确认得到的波形是正确的。脉冲分配器：观察真值表可以发现，无论是 X=0 还是 X=1，输出变量 QA、QB、QC 的序列都是000111，因此可以发现所得到的波形中 QA、QB、QC 是非常相似的。2、 调试过程电路的搭建与调试采用自下而上的方法，每完成一个步骤都对目前的电路进行测试，确认正确性，在发生错误时及时调试，然后再继续搭建与调试。这样做既能节省时间也可以确保电路的正确性。遇到的问题：在搭建同步十进制加法计数器的时候，我们需
5、要使用 4 个 JK 触发器，搭建完毕之后，发现输出的结果一直从 3 到 6 循环，极偶然的情况下会从 0 到 9 循环，反复检查电路，始终没能发现问题所在。解决方法：在搭建过程中，由于需要给 4 个 JK 触发器都加上同步的 CP 脉冲，我采用了串联的方式，但这样的做法会有一定的延时效应，因此产生了问题。将 CP 脉冲直接连接到 4 个 JK 触发器，即解决问题。3、 如何用一个三输入与非门设计自启动电路如何实现脉冲发生器的自启动功能在前面的实验设计中已有阐述，实验中 000 和 111 为无效输出，因此在出现这样的输出时，应置为有效状态，按照下列函数表达式接线，即可使得 000 转换为 1
6、00、111转换为 101。四、 讨论与心得本次实验是本学期最后一个实验，实验要求完成的内容较多，但很多内容已经在先前的实验中被反复提及，但我却在这最后一次的实验中犯了一个基础错误CP 脉冲不能串联接线，导致我在第一步的同步二进制加法计数器的接线中浪费了许多时间。因此可以知道掌握数字电路实际情况的一些注意事项的重要性，与未来我们可能面对的电路相比，本次实验绝对是微不足道的，在那时这样的小错误带来的影响就更加难以估计了。在第一个实验中我们使用了 4 个 JK 触发器，第二个实验使用了 3 个 D 触发器，还有一系列的逻辑门，可见本次实验中各个电路的接线是极其复杂的。在这样的情况下，自下而上的接线方式就更加体现出优势来了，每完成实验的一个环节都对目前的情况进行测试与调试，以免错误不断积累，导致最后难以找到错误发生的原因，这样保证了电路一定的准确性。本次实验完成的第一个步骤是实验设计：对要实现的功能进行分析，画出状态转换图，得到真值表，利用卡诺图获得函数表达式。这一过程是我们在理论课中已经学习的，但在本次实验中才真正理论运用于实践，了解实验设计这一流程对于我们自主地完成一些功能的实现是极其有帮助的，这也是本次实验最根本的目的。
