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vhdl期末考试复习题.doc

上传人:tkhy51908 文档编号:6893920 上传时间:2019-04-25 格式:DOC 页数:2 大小:40.50KB
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VHDL 复习一问答题1 信号赋值语句在什么情况下作为并行语句?在什么情况下作顺序语句?信号赋值和变量赋值符号分别是什么?两种赋值符号有什么区别? 信号赋值语句在进程外作并行语句,并发执行,与语句所处的位置无关。信号赋值语句在进程内或子程序内做顺序语句,按顺序执行,与语句所处的位置有关。 信号赋值符号为“qqqqQQ=0; END CASE; END archtest;答案:CASE 语句应该存在于进程 PROCESS 内。

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