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VHDL实用教程_潘松_王国栋.pdf

上传人:HR专家 文档编号:6229306 上传时间:2019-04-03 格式:PDF 页数:366 大小:3.13MB
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1、KONXIN KONXIN EDA VHDL KONXIN KONXIN VHDL VHDL EDA VHDL 1 7 9 10 FPGA 11 VHDL EDA 12 VHDL 13 VHDL 14 VHDL 12 VHDL 13 EDA / VHDL EDA 028 6636481 6241146 3201496 VHDL : ( 610054) : : : : 787 1092 1/16 14.875 343 : 1999 12 : 1999 12 : ISBN 7 81065 290 7/TP 172 : 1 5000 : 25.00 KONXIN KONXIN VLSI 1 EDA

2、Electronic Design Automation 2 3 4 ASIC SOC System On a Chip EDA VLSI FPGA CPLD Xilinx Altera FPGA/CPLD FPGA GAL Lattice PLD/CPLD ISP CPLD 23% Cadence Data I/O Mentor Graphics OrCAD Synopsys Viewlogic EDA EDA CAD CAM CAT CAE EDA ESDA Electronic System Design Automation EDA EDA VHDL FPGA CPLD EDA VHD

3、L IEEE EDA EDA EDA VHDL VHDL EDA ASIC IP Intelligence Property Core KONXIN KONXIN EDA EDA VHDL VHDL VHDL EDA VHDL 1 VHDL 2 VHDL VHDL 3 VHDL 1 VHDL 11 14 2 12 3 PC VHDL EDA VHDL / EDA 3 1 2 VHDL VHDL / EDA E-mail 0571-5525171 / 5972935 65 310012 E-mail Hjwanguestc.educn 028 3203189 028 3251067-8999

4、610054 2001 3 KONXIN KONXIN 1 1 1 1.1 EDA.1 1.2 VHDL 3 1.3 5 1.4 VHDL EDA .6 1.5 9 1.6 FPGA/CPLD .10 1.7 VHDL .10 2 VHDL 12 2.1 VHDL .12 2.2 VHDL .15 3 VHDL 19 3.1 ENTITY 19 3.2 ARCHITECTURE 26 3.3 BLOCK .29 3.4 PROCESS .32 3.5 (SUBPROGRAM) 35 3.5.1 FUNCTION 36 3.5.2 OVERLOADED FUNCTION 39 3.5.3 PRO

5、CEDURE .42 3.5.4 OVERLOADED PROCEDURE 44 3.6 LIBRARY .45 3.7 PACKAGE 48 3.8 CONFIGURATION 51 53 4 VHDL 55 4.1 VHDL 55 4.2 VHDL 58 4.2.1 (VARIABLE)59 4.2.2 (SIGNAL) .60 4.2.3 (CONSTANT).63 4.3 VHDL 64 4.3.1 VHDL 65 4.3.2 IEEE .68 4.3.3 70 4.3.4 71 4.3.5 73 4.3.6 74KONXIN KONXIN 2 4.3.7 74 4.3.8 76 4.

6、3.9 78 4.4 VHDL 82 4.4.1 82 4.4.2 83 4.4.3 85 4.4.4 87 4.4.5 93 .94 5 VHDL 95 5.1 95 5.1.1 96 5.1.2 97 5.2 99 5.2.1 IF 99 5.2.2 CASE .102 5.2.3 LOOP .106 5.2.4 NEXT .109 5.2.5 EXIT 110 5.3 WAIT .111 5.4 115 5.5 (RETURN)118 5.6 (NULL) .119 5.7 120 5.7.1 (ATTRIBUTE) 120 5.7.2 (TEXTIO) .125 5.7.3 ASSER

7、T .127 5.7.4 REPORT 128 5.7.5 128 .129 6 VHDL 131 6.1 132 6.2 137 6.3 138 6.3.1 138 6.3.2 138 6.3.3 139 6.4 141KONXIN KONXIN 3 6.5 143 6.6 145 6.7 146 .151 7 VHDL 153 7.1 153 7.2 155 7.3 156 .157 8 158 8.1 VHDL 158 8.2 162 8.2.1 163 8.2.2 163 8.3 d 164 8.4 164 8.5 VHDL 166 8.6 VHDL 169 .170 9 171 9.

8、1 VHDL 171 9.2 174 9.3 175 9.3.1 175 9.3.2 180 9.3.3 183 9.3.4 184 9.3.5 184 9.4 186 9.5 190 9.6 194 .196 10 FSM .198 10.1 199 10.2 210 10.3 212 .213 11 215 11.1 FPGA .215KONXIN KONXIN 4 11.2 FIR 217 11.2.1 FIR .217 11.2.2 FIR .220 11.2.3 FIR .223 11.2.4 FIR .227 11.3 IIR .229 11.3.1 IIR 229 11.3.2

9、IIR 232 .234 12 VHDL 235 12.1 ispVHDL 235 12.1.1 ispLSI .236 12.1.2 ispVHDL 236 12.1.3 ispVHDL 237 12.2 Altera MAX+plus II VHDL 246 12.3 MAX+plus II Synplify 254 12.4 Xilinx Foundation VHDL 256 12.4.1 Foundation .256 12.4.2 VHDL 257 .264 13 VHDL 265 13.1 8 .265 .267 13.2 .267 .268 13.3 SRAM 269 .270

10、 13.4 270 .271 13.5 8 .271 .273 13.6 8 .273 .278 13.7 278 .283 13.8 283 .284 13.9 284 .286KONXIN KONXIN 5 13.10 “ .287 .292 13.11 RS232 .292 .295 13.12 296 .299 13.13 PC FPGA .299 .301 13.14 VGA .301 .304 13.15 A/D 304 .308 13.16 D/A .308 .310 13.17 MCS-51 CPLD .310 13 17 1 310 13 17 2 312 .313 13.1

11、8 PS/2 314 13.19 7 LED 315 .316 14 317 14.1 317 14.1.1 317 14.1.2 318 14.1.3 VHDL .320 14.1.4 323 14.1.5 324 14.2 .325 .326 1 GW48 EDA .327 2 FPGA CPLD .344KONXIN KONXIN 1 1 1 SSI MCU SSI MCU SSI FPGA/CPLD / EDA MCU MCU FPGA/CPLD MCU EDA FPGA/CPLD MCU MPU DSP A/D D/A RAM ROM / IP CPLD FPGA EDA 1.1 EDA 8255 VHDL 2 PLD EDA TTL EDA EDA Electronic Design Automation 90 CAD CAM CAT CAE EDA EDA HDL EDA EDA EDA

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