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EDA实验报告二(一位全加器的设计).doc
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1、实验二:一位全加器的设计一、实验目的 1、了解和学习Quartus II 7.2软件设计平台。 2、了解EDA的设计过程。 3、通过实例,学习和掌握Quartus II 7.2平台下的文本输入法。4、学习和掌握全加器的设计原理。5、初步掌握该实验的软件仿真过程。二、实验仪器PC机,操作系统为Windows7,本课程所用系统均为Windows7(下同),Quartus II 7.2设计平台。3、 实验步骤1、 创建工程,在File菜单中选择New Project Wizard,弹出对话框 如下图所示 在这个窗口中第一行为工程保存路径,第二行为工程名,第三行为顶层文件实体名,和工程名一样。 2、新
2、建设计文本文件,在file中选择new,出现如下对话框: 选择VHDL File 点击OK。2、 文本输入,在文本中输入如下程序代码:library ieee;use ieee.std_logic_1164.all;ENTITY xor31 isport (a,b,cin:in std_logic; sum:out std_logic);end xor31;ARCHITECTURE d1 OF xor31 isbegin sum=a xor b xor cin;end d1;library ieee;use ieee.std_logic_1164.all;ENTITY and21 isport
